在ADS,genesys中 進行器件建模的討論
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現將本人翻譯的幫助文件,貼出,拋磚引玉。
問題:按照幫助文件的步驟,卻實現不了。
見解:可能是幫助中步驟3理解不夠準確。請高人看看!
如果此問題能解決,那以后在ADS,genesys中 進行器件建模就很方便了
Verilog-A Models.pdf
(2008-03-02 15:07:10, Size: 64.9 KB, Downloads: 50)
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我也遇到這個問題!不知如何解決!
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